| 基于HEVC帧内硬件编码器的架构及算法 |
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| 引用本文： | 张晓宁,王克,谭伟峰,习朝辉,张志峰.基于HEVC帧内硬件编码器的架构及算法[J].火力与指挥控制,2020,45(3). |
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| 作者姓名： | 张晓宁 王克 谭伟峰 习朝辉 张志峰 |
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| 作者单位： | 北方自动控制技术研究所,太原 030006,北方自动控制技术研究所,太原 030006,北方自动控制技术研究所,太原 030006,北方自动控制技术研究所,太原 030006,北方自动控制技术研究所,太原 030006 |
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| 摘 要： | 针对战场视频情报的编解码,提出了一种基于HEVC标准的帧内编码器的硬件结构及算法实现,支持分辨率为2160@30fps视频的实时帧内编码操作。编码器基于码域的bin计数和基于变换域的失真估计简化率失真分析,可以对大量帧内预测模式进行筛选。同时建立单独的4×4块重构回路,以支持帧内4×4模式;不同尺寸的块交叉处理以补偿重构回路的延时。编码器的实现使用了TSMC-90 nm芯片的1 086 k门以及52 kB片上内存。在2160p@30fps视频序列下,相比于HM软件,BD-Rate均值为5.46%。
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| 关 键 词： | 视频情报 视频编码 帧内预测 HEVC FPGA 时序 |
Hardware Architecture and Algorithm Based on HEVC Intra Encoder |
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| ZHANG Xiao-ning,WANG Ke,TAN Wei-feng,XI Zhao-hui,ZHANG Zhi-feng.Hardware Architecture and Algorithm Based on HEVC Intra Encoder[J].Fire Control & Command Control,2020,45(3). |
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| Authors: | ZHANG Xiao-ning WANG Ke TAN Wei-feng XI Zhao-hui ZHANG Zhi-feng |
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