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本合成器输出频率为VHF频段低端,频率间隔为25kHz,设计方案是在常规单环法的基础上,应用微机对VCO实现快速预置和小数分频等技术,使环路在最大起始频差时,锁定时间小于500微秒。通过试验,本文对减少环路捕捉时间的有关技术进行了论述,同时给出合成器一些指标的实测结果。 相似文献
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DDS/PLL技术在跳频抗干扰中的应用 总被引:1,自引:0,他引:1
本文阐述了跳频扩频的基本原理,进而提出了一种利用DDS/PLL实现FH的方法,并从相位噪声和杂散的角度出发,对它的性能进行了较详细的分析,最后提出了一种适用于跳频抗干扰通信系统的具体方案及其实验电路和测试结果。此频率合成器将国外产品化的直接数字频率合成器技术和传统的锁相环技术有机地结合起来,具有结构简单、频率分辨率高、频率转换速度快、杂散小、相位噪声低等优点。 相似文献
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提出了一种适用于跳频通信的高速PLL频率合成器,并给予了实现。由于以往的PLL环路采用了低通滤波器,所以很难实现高速换频。与此不,本PLL环路采用了不需要低通滤波器的取样保持型相位比较器。在换频时,对PLL环路给出实始值,实现输出频率高速捕获。而对应各频率的初始值可利用跳频通信载波跳变的周期性,根据与前一周期同一频率在PLL稳定状态的相位差获得。最后以实验验证了所提方法的正确性。根据本方法可把换频 相似文献
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本文提出一种新的自适应锁相频率合成器方案,它具有快的换频响应速度,高的频率分辨率和较纯的输出信号频谱,以及实现容易等优点。文中给出了实现框图,并对其原理作了较详细的说明。最后,从理论上计算了合成器换频所需时间,讨论了合成器环路对小数分频所引起的尾数效应的抑制。 相似文献
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在跳频通信系统中,接收机需要在取样带宽内实时地监测和复现当前的跳频频点,再对高频率的跳频信号进行下变频。针对快跳频、宽频带的跳频通信系统,提出了一种宽频带级联数字下变频方法,该方法包括信道化和复数下变频2个过程。信道化结构实现各分析信道的基带下变频,该过程相对独立,不参与频偏补偿,进而降低了级联数字下变频结构的反馈复杂度。复数下变频过程进一步将位于物理信道的信号搬至基带,该过程在低速率下完成若干固定频率的二次下变频,便于进行频偏补偿。通过仿真可知,该方法能够实时地实现数字下变频过程,该跳频通信系统在Eb/N0等于12 dB时误码率小于10~(-6)。 相似文献
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本文基于对载波序列的相位进行编码的方法提出了一种新的跳频通信技术-载波序列差分相位跳频。阐述了利用载波序列携带用户数据信息的差分相位跳频通信的原理,给出了载波序列差分相位跳频通信的系统构成。讨论了载波序列差分相位跳频系统的传输和同步.跳频图案的随机性和功率谱的均匀性.以及跳频组网应用的问题。还分析了CHESS系统所采用的差分(频率)跳频技术的特点及其固有的局限性,并且指出:若采用载波序列差分相位跳频技术,则可从根本上消除CHESS系统存在的局限性。并可构成易于与传统跳频系统相兼容的新一代跳频通信系统。 相似文献